1 引言
最近在接触使用国产安路科技公司的FPGA进行相关的开发,TD(Tang Dynasty)作为一款安路FPGA开发工具与Quartus 使用大致相同,但仍旧有一定的不同。
2 基本配置流程
这里推荐以官方使用手册作为参考进行实践,首先需要完成TD软件内部的操作。
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2.1 TD软件设置操作
1. Process
⇒
\Rightarrow
⇒ Properties
⇒
\Rightarrow
⇒ Optimize RTL :
rtl_sim_model : ON
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2. Process
⇒
\Rightarrow
⇒ Properties
⇒
\Rightarrow
⇒ Optimize Gate :
gate_sim_model : ON
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3. Process
⇒
\Rightarrow
⇒ Properties
⇒
\Rightarrow
⇒ Optimize Routing :
phy_sim_model : ON
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4. Process
⇒
\Rightarrow
⇒ Properties
⇒
\Rightarrow
⇒ Timing Option :
sdf : ON
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5.设置相关仿真参数
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6.运行Simulation
![在这里插入图片描述](https://img-blog.csdnimg.cn/81518f429dab47d38779b29df4ccf716.png#pic_center)
7.选择相关测试文件(testbench文件)
![在这里插入图片描述](https://img-blog.csdnimg.cn/6a14c855fec9429cba348decfc4d823f.png#pic_center)
这里有两种方式,第一种是添加已经存在的tb文件进行测试;第二种是新建一个新的测试文件。
8.完成上述步骤之后会生成两个文件:①testbench文件 ②脚本文件do文件。
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完成这些步骤之后,TD软件这边的设置便已经完成,下面需要完成Modelsim软件方面的设置。
2.2 Modelsim软件方面设置
-
首先进入TD安装目录,在改目录下有一个文件夹为sim_release的文件,文件夹下是一些对应芯片的仿真文件,因为这里使用的芯片为EF2L45LG144B。所以仅复制EF2文件夹下的相关文件。(这里一定要注意根据芯片类型选择复制的文件夹)![在这里插入图片描述](https://img-blog.csdnimg.cn/6eaa23dc64e0460a8f34d0716b7f3809.png#pic_center)
-
在Modelsim安装根目录下新建一个文件夹(Anlogic),将刚才复制的EF2文件夹复制进新建的Anlogic >> src文件夹内。此时src文件夹内便存放着大量该芯片的仿真文件。
![在这里插入图片描述](https://img-blog.csdnimg.cn/b62d13477d5f4f1499fe6ccb5748e503.png#pic_center)
- 打开Modelsim,File
⇒
\Rightarrow
⇒ Change Directory
⇒
\Rightarrow
⇒ 修改当前目录为刚创建的Modelsim根目录下的Anlogic文件夹。
![在这里插入图片描述](https://img-blog.csdnimg.cn/762f7ca5b2a84f7b8617cc29de01766f.png#pic_center)
![在这里插入图片描述](https://img-blog.csdnimg.cn/5c801d176ef34fef8ac7667ee4cea3f4.png#pic_center)
-
File
⇒
\Rightarrow
⇒ New
⇒
\Rightarrow
⇒ Library
⇒
\Rightarrow
⇒ 新建安路仿真库。库名字设置为EF2_ver。
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![在这里插入图片描述](https://img-blog.csdnimg.cn/fbbe048c02174846b2fc615799b7e509.png#pic_center)
5.Compile
⇒
\Rightarrow
⇒ Compile
⇒
\Rightarrow
⇒ 编译新库
![在这里插入图片描述](https://img-blog.csdnimg.cn/e9248588e5da41839f74426287d635e8.png#pic_center)
![在这里插入图片描述](https://img-blog.csdnimg.cn/a4dfd17c016e49feb5385fea7363bdcc.png#pic_center)
6.回到TD软件,设置Lib,重新进行Simulation。
![在这里插入图片描述](https://img-blog.csdnimg.cn/1745f486c3b6441aacb7457b1bae2691.png#pic_center)
-
将TD工程目录下的tb文件和原始Verilog文件进行拷贝到modelsim根目录Anlogic文件夹下的新建文件夹内,作为工程文件。
![在这里插入图片描述](https://img-blog.csdnimg.cn/77c8df0910c240ac9c6f30f06cb55b47.png#pic_center)
8.在Modelsim中新建工程文件
![在这里插入图片描述](https://img-blog.csdnimg.cn/6fd3f39f9cdb4bfe89cc5bbc7375bc29.png#pic_center)
![在这里插入图片描述](https://img-blog.csdnimg.cn/2de592c83a1f42df857a253b46e232f9.png#pic_center)
9.为工程加入测试文件
![在这里插入图片描述](https://img-blog.csdnimg.cn/c61e11df368241bc9ab6aae772a16b7e.png#pic_center)
10.加入文件后进行编译,编译之前一定要对tb文件进行初值的幅值与修改。即修改initial语句中的定义部分。
![在这里插入图片描述](https://img-blog.csdnimg.cn/b649129eef4947c8a194a78b6aebc4ef.png#pic_center)
![在这里插入图片描述](https://img-blog.csdnimg.cn/be7f3fd8e9ea4feca0c050d0bdd30ac1.png#pic_center)
11.启动仿真,设置仿真文件,加入仿真库
![在这里插入图片描述](https://img-blog.csdnimg.cn/9656ef1832ed441787fe904ab7152dfa.png#pic_center)
![在这里插入图片描述](https://img-blog.csdnimg.cn/da1e274313f343268d8c92ee94cf7421.png#pic_center)
![在这里插入图片描述](https://img-blog.csdnimg.cn/2c12ecd733414703b4dc3c39fc61ef38.png#pic_center)
12.仿真结果
![在这里插入图片描述](https://img-blog.csdnimg.cn/d42f88dbc01e4d34ab80daee5ab3abc7.png#pic_center)
![在这里插入图片描述](https://img-blog.csdnimg.cn/bad1904245b64acda667196b7b5fa4a2.png#pic_center)